AMD Tech Day - AIE for DSP
26 Mar 2026 - 26 Mar 2026
Italy, Milan
AI Engines per Applicazioni DSP su Versal, Versal RF, Versal Gen2
Avnet Silica, in collaborazione con gli specialisti AMD, è lieta di invitarti al Tech Day dedicato agli AI Engines, la tecnologia alla base delle più avanzate applicazioni DSP sulle piattaforme Versal Adaptive SoC. Gli AI Engines (AIE / AIE‑ML) rappresentano il cuore computazionale delle piattaforme AMD Versal, progettati per accelerare algoritmi DSP complessi con efficienza, throughput elevato e latenza deterministica. Il Tech Day offre una panoramica completa sulle architetture hardware, sui flussi di sviluppo e sugli strumenti Vitis, con un percorso tecnico guidato da esperti AMD e Avnet Silica. L’evento è rivolto a: Ingegneri elettronici, System architect, Firmware/SW developers, Ricercatori e progettisti DSP e a tutti coloro che desiderano sfruttare al massimo le potenzialità degli AI Engines per applicazioni avanzate in ambito DSP, RF, imaging, comunicazioni e molto altro.
Durante il Tech Day verranno trattati i seguenti argomenti:
- Introduzione hardware agli AI Engines
- Architettura AIE, AIE‑ML, pipeline VLIW/SIMD, memoria locale, flussi dati.
- Flussi di sviluppo e metodi di verifica
- Vitis Integrated Flow; Vitis Export to Vivado Flow
- Vitis Subsystem Flow; Vitis Model Composer
- Vitis Functional Simulation; Hardware-in-the-Loop (HIL)
- System Partitioning & Rapid Prototyping
- Best practice per suddivisione algoritmica tra AIE, PL e PS.
- Esempi concreti di prototipazione rapida.
- Implementazione di un Polyphase Channelizer
- Utilizzo delle DSP Libraries e ottimizzazione in AIE.
- AIE API per FIR e FFT custom
- Progettazione, ottimizzazione e scalabilità delle pipeline DSP.
- Concetto di Base e Custom Platform
- Come creare e utilizzare piattaforme personalizzate per acceleratori AIE.
Data e luogo
- 26 Marzo, 2026 - Uffici Avnet Silica Milano, Via Manzoni 44 Cusano Milanino (MI), Italia
Costo
La partecipazione è gratuita, ma i posti sono limitati.
Agenda
| Orario | Argomento |
|---|---|
| 08:30 - 09:00 | Arrivo / Registrazione |
| 09:00 - 09:15 | Introduzione |
| 09:15 - 10:45 | Complete System Implementation & Simulation Flow |
| 10:45 - 11:00 | Break |
| 11:00 - 11:45 | System Partitioning & Rapid Prototyping |
| 11:45 - 13:00 | Lunch |
| 13:00 - 14:00 | AIE/AIE ML DSP Design (FIR, Channelizer) |
| 14:00 - 14:45 | AIE Hand Coded FFT/FIR |
| 14:45 - 15:00 | Break |
| 15:00 - 15:45 | Vitis Model Composer / Hardware in the Loop |
| 15:45 - 16:30 | Base & Custom Platform |
| 16:30 - 17:00 | Wrap-up & Conclusioni |
Registration
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